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Who-T 30.04.2002 17:40

semaphoren dienen zum vermeiden von race conditions in critical sections, wenn ich mich recht erinnere.
schau mal unter diesen begriffen im google nach.

von neumann hat im gegensatz zur harvard (oder wie man das schreibt) architektur keinen getrennten daten und programmspeicher, sondern einen gemeinsamen.
das ist die architektur, die sich im prinzip bei homecomputern durchgesetzt hat, jedoch auch viren ermöglicht, da sich die programme selbst umschreiben können.

hoff ich hab in snt brav aufgepasst....

pc.net 30.04.2002 18:02

who-t hats schon recht gut auf den punkt gebracht ...

nachzulesen gibts im netz auch genug

Stona 30.04.2002 20:43

56 von 60

flocky 30.04.2002 20:45

na leutz ihr seids gut...

ich habs mit google nur auf 49 gebracht...
aber kerning is feinabstimmung der abstände von buchstaben !

CISK 30.04.2002 20:59

Wofür steht die Abkürzung EVA?
 
Erste allgeimeine verunsicherung?




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Frage 40 von 60 :


ROM bedeutet...
Bildschirmspeicher
Netzwerkstation
Festwertspeicher
Die CD enthält Computersoftware
Reliable Optical Memory
keine Antwort

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???

Who-T 30.04.2002 21:03

Read Only Memory
Festwertspeicher

interessante übersetzung, aber das einzige was in frage kommt

flocky 30.04.2002 21:04

Re: Wofür steht die Abkürzung EVA?
 
? WAS ? IS ?

Who-T 30.04.2002 21:06

eingabe verarbeitung ausgabe

auf das hab ich zumindest getippt
der begriff is aber glaub ich aus der zeit der batch-jobs

glaub ich halt

flocky 30.04.2002 21:08

du warst nich gemeint, da gifty postet unverständliches...

Stona 30.04.2002 21:23

Ergänzung zur Von-Neumann-Architektur:


Folgt strickt dem Ablauf:
Befehl laden, decodieren, ausführen, speichern.
Dabei, wie Who_T schon gesagt hat, steht nur ein gemeinsamer Bus für Daten und Befehle zur Verfügung -> typischer Flaschenhals.
pro Taktzyklus wird ein Befehl ausgeführt.

Heute verwendet man die Harvard Architektur (getrennter Bus f. Daten und Befehle) bzw. die Enhanced - Harvard (ein Instruction Bus, 2 Datenbusse) bzw. die Harvard 3-Bus Architektur (v.a. bei DSPs, 1x Instruction-Bus, 2x Data read, 1x data write).
Verbessert unter anderem die Performance von Pipelines und verringert Pipeline stalls (Taktschritte, in denen eine oder mehrer Pipelinestufen nix hackeln können, weil z.B. der Bus blockiert ist)
Die Pinzahl des Gehäuses steigt natürlich enorm duch eine Harvard Busarchitektur.


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